Các họ vi mạch logic cơ bản

CÁC HỌ VI MẠCH LOGIC CƠ BẢN CÁC HỌ VI MẠCH LOGIC CƠ BẢN I. TỔNG QUAN………………………………………………………………..3 1. Các họ mạch logic lưỡng cực……………………………………………3 2. Các họ mạch logic đơn cực...……………………………………………3 II. ĐẶC ĐIỂM CHUNG CỦA CÁC VI MẠCH LOGIC…………………….4 1. Phân loại các IC số………………………………….……………………4 2. Các đặc trưng……………………………………………………………..4 III. CÁC HỌ CỔNG LOGIC………………………………………………….10 1. Họ DDL (DIODE DIODE LOGIC)…………………………………….11 2. Họ DTL (DIODE-TRANSISTOR LOGIC) …………………………..13 3. Họ TTL (TRANSISTOR-TRANSISTOR LOGIC) ……………………13 a. Các đặc điểm của họ TTL chuẩn………………………………………..14 b. Họ TTL cải tiến…………………………………………………………15 c. TTL với ngõ ra cực thu hở (OPEN COLLECTOR OUTPUT)………....17 d. Họ TTL ba trạng thái (TRISTATE)…………………………………….17 1. Họ RTL (RESISTOR-TRANSISTOR LOGIC).……………………….18 2. Mạch logic MOS……………………………………………………….19 a. Họ CMOS……………………………………………………………….21 b. Cổng cơ bản NMOS………………………………….…………………26 1. Họ ECL (EMITTER COUPLED LOGIC)……………………………...27 CÁC HỌ VI MẠCH LOGIC CƠ BẢN 2 2. Tóm tắt đặc trưng của một vài họ cổng logic…………………………...28 3. IC số……………………………………………………………………..29 a. Mức tích hợp…………………………………………………………….30 b. Kí hiệu vỏ của IC số…………………………………………………….30 c. Một số IC thường gặp…………………………………………………...31 z CÁC HỌ VI MẠCH LOGIC CƠ BẢN 3 CÁC HỌ VI MẠCH LOGIC CƠ BẢN I. TỔNG QUAN Xét về cơ bản có 2 lọai thiết bị bán dẫn là lưỡng cực và đơn cực. Dựa trên các thiết bị này, các mạch tích hợp được hình thành. 1. Các họ mạch logic lưỡng cực: Các yếu tố chính của IC lưỡng cực là điện trở, diode và BJT, hai họat động trong IC lưỡng cực là: tắt và bão hòa, các họ logic lưỡng cực:  Mạch logic DDL • Mạch logic RTL • Mạch logic DCTL • Mạch logic HTL • Mạch logic TTL • Mạch logic Schottky TTL • Mạch logic ECL 2. Các họ mạch logic đơn cực: Các thiết bị MOS là các thiết bị đơn cực và chỉ có các MOSFET được vận hành trong các mạch logic MOS, các mạch logic MOS là: • PMOS • NMOS • CMOS II. ĐẶC ĐIỂM CHUNG CỦA CÁC VI MẠCH SỐ 1. Phân lọai các IC số: CÁC HỌ VI MẠCH LOGIC CƠ BẢN 4 Loại IC Các cổng căn bản Số các linh kiện Tổ hợp quy mô nhỏ SSI Nhỏ hơn 12 Lên đến 99 Tổ hợp quy mô trung bình MSI 12-99 100-999 Tổ hợp quy mô lớn LSI 100-999 100-999 Tổ hợp quy mô rất lớn VLSI Lớn hơn 1000 Lớn hơn 10000 2. Các đặc trưng: a. Tốc độ họat động, lệ thuộc vào thời gian trễ truyền đạt. - Có hai loại thời trễ truyền: Thời trễ truyền từ thấp lên cao t PLH và thời trễ truyền từ cao xuống thấp t PHL . Hai giá trị này thường khác nhau. Sự thay đổi trạng thái được xác định ở tín hiệu ra. Thí dụ tín hiệu qua một cổng đảo - Tùy theo họ IC, thời trễ truyền thay đổi tử vài ns đến vài trăm ns. Thời trễ truyền càng lớn thì tốc độ làm việc của IC càng nhỏ. b. Tổn hao công suất (Power requirement), xác định bởi tích số nguồn cung cấp Vcc và dòng Icc (giá trị trung bình của dòng Icc mức 0 và mức 1), đơn vị mW. CÁC HỌ VI MẠCH LOGIC CƠ BẢN 5 PD (avg) = ICC (avg) . VCC c. Chỉ số giá trị, xác định bởi tích số tốc độ và công suất - Để đánh giá chất lượng IC, người ta dùng đại lượng tích số công suất-vận tốc đó là tích số công suất tiêu tán và thời trễ truyền. Chỉ số giá trị (pJ) = thời gian trì hoãn truyền đạt (ns) x công suất (mW). - Thí dụ họ IC có thời trễ truyền là 10 ns và công suất tiêu tán trung bình là 50 mW thì tích số công suất-vận tốc là: 10 ns x 5 mW =10.10 -9 x5.10 -3 = 50x10 -12 watt-sec = 50 picojoules (pj) - Chỉ số giá trị càng nhỏ càng tốt - Trong quá trình phát triển của công nghệ chế tạo IC người ta luôn muốn đạt được các IC có công suất tiêu tán và thời trễ truyền càng nhỏ càng tốt. Như vậy một IC có chất lượng càng tốt khi tích số công suất-vận tốc càng nhỏ. Tuy nhiên trên thực tế hai giá trị này thay đổi theo chiều ngược với nhau, nên ta khó mà đạt được các giá trị theo ý muốn, dù sao trong quá trình phát triển của công nghệ chế tạo linh kiện điện tử trị số này luôn được cải thiện . d. Hệ số tải, là số cổng có thể được vận hành bởi một cổng, hệ số tải càng cao càng thuận lợi. e. Các tham số dòng và áp - V CC : Điện thế nguồn (power supply): khoảng điện thế cho phép cấp cho IC để hoạt động tốt. Thí dụ với IC số họ TTL, V CC =5±0,5 V , họ CMOS V DD =3- 15V (Người ta thường dùng ký hiệu V DD và V SS để chỉ nguồn và mass của IC họ MOS) CÁC HỌ VI MẠCH LOGIC CƠ BẢN 6 - Điện áp đầu vào ở mức cao VIH (High level input voltage) : điện áp tối thiểu mà cổng có thể nhận biết mức 1 - Điện áp đầu vào ở mức thấp VIL (Low level input voltage) : điện áp tối đa mà cổng có thể nhận biết mức 0 - Điện áp đầu ra ở mức cao VOH (High level output voltage) : điện áp tối thiểu tại đầu ra tương ứng mức 1 - Điện áp đầu ra ở mức thấp VOL (Low level output voltage) : điện áp tối đa tại đầu ra tương ứng mức 0 - Cường độ dòng điện đầu vào mức cao IIH (High level input current) : dòng tối thiểu được cung cấp tương ứng với mức 1 - Cường độ dòng điện đầu vào mức thấp IIL (Low level input current) : dòng tối đa được cung cấp tương ứng với mức 0 - Cường độ dòng điện đầu ra mức cao IOH (High level output current) : dòng cực đại mà ngõ ra cung cấp tương ứng với mức 1 - Cường độ dòng điện đầu ra mức thấp IOH (Low level output current): dòng cực tiểu mà ngõ ra cung cấp tương ứng với mức 0 - I CCH ,I CCL : Dòng điện chạy qua IC khi ngõ ra lần lượt ở mức cao và thấp. f. Nhiễu - Các tín hiệu nhiễu như tia lửa điện, cảm ứng từ có thể làm thay đổi trạng thái logic của tín hiệu do đó ảnh hưởng đến kết quả hoạt động của mạch. - Tính miễn nhiễu của một mạch logic tùy thuộc khả năng dung nạp hiệu thế nhiễu của mạch và được xác định bởi lề nhiễu. Lề nhiễu có được do sự chênh lệch của các điện thế giới hạn (còn được gọi là ngưỡng logic) của mức cao và thấp giữa ngã ra và ngã vào của các cổng CÁC HỌ VI MẠCH LOGIC CƠ BẢN 7 - Tín hiệu khi vào mạch logic được xem là mức 1 khi có trị >V IH (min) và là mức 0 khi <V IL (max). Điện thế trong khoảng giữa không ứng với một mức logic nào nên gọi là vùng bất định. Do có sự khác biệt giữa V OH (min) với V IH (min) và V OL (max) với V IL (max) nên ta có 2 giá trị lề nhiễu: Lề nhiễu mức cao: V NH = V OH (min) - V IH (min) Lề nhiễu mức thấp: V NL = V IL (max) - V OL (max) - Khi tín hiệu ra ở mức cao đưa vào ngã vào, bất cứ tín hiệu nhiễu nào có giá trị âm và biên độ >V NH đều làm cho điện thế ngã vào rơi vào vùng bất định và mạch không nhận ra được tín hiệu thuộc mức logic nào. Tương tự cho trường hợp ngã ra ở mức thấp tín hiệu nhiễu có trị dương biên độ >V NL sẽ đưa mạch vào trạng thái bất định. CÁC HỌ VI MẠCH LOGIC CƠ BẢN 8 g. Miền nhiệt độ họat động, từ 0-700C cho các ứng dụng tiêu dùng và công nghiệp, từ 550C – 1250C cho các mục đích quân sự. h. Logic cấp dòng và logic nhận dòng - Một mạch logic thường gồm nhiều tầng kết nối với nhau. Tầng cấp tín hiệu gọi là tầng thúc và tầng nhận tín hiệu gọi là tầng tải. Sự trao đổi dòng điện giữa hai tầng thúc và tải thể hiện bởi logic cấp dòng và logic nhận dòng. Hình (a) cho thấy hoạt động gọi là cấp dòng: Khi ngã ra mạch logic 1 ở mức cao, nó cấp dòng I IH cho ngã vào của mạch logic 2, vai trò như một tải nối mass. Ngã ra cổng 1 như là một nguồn dòng cấp cho ngã vào cổng 2 CÁC HỌ VI MẠCH LOGIC CƠ BẢN 9 Hình (b) cho thấy hoạt động gọi là nhận dòng: Khi ngã ra mạch logic 1 ở mức thấp, nó nhận dòng I IL từ ngã vào của mạch logic 2 xem như nối với nguồn V CC . - Thường dòng nhận của tầng thúc khi ở mức thấp có trị khá lớn so với dòng cấp của nó khi ở mức cao, nên người ta hay dùng trạng thái này khi cần gánh những tải tương đối nhỏ, ví dụ khi chỉ cần thúc cho một led, người ta có thể dùng mạch (Hình a) mà không thể dùng mạch (Hình b). i. Tính Schmitt Trigger - Trong phần giới thiệu lề nhiễu, ta thấy còn một khoảng điện thế nằm giữa các ngưỡng logic, đây chính là khoảng điện thế ứng với transistor làm việc trong vùng tác động. Khoảng cách này xác định lề nhiễu và có tác dụng làm giảm độ rộng sườn xung (tức làm cho đường dốc lên và dốc xuống của tín hiệu ra dốc hơn) khi qua mạch. Lề nhiễu càng lớn khi vùng chuyển tiếp của ngã vào càng nhỏ, tín hiệu ra thay đổi trạng thái trong một khoảng thời gian càng nhỏ nên sườn xung càng dốc. Tuy nhiên vẫn còn một khoảng sườn xung nằm trong vùng chuyển tiếp nên tín hiệu ra không vuông hoàn toàn. CÁC HỌ VI MẠCH LOGIC CƠ BẢN 10 - Để cải thiện hơn nữa dạng tín hiệu ngã ra, bảo đảm tính miễn nhiễu cao, người ta chế tạo các cổng có tính trễ điện thế, được gọi là cổng Schmitt Trigger (hình a). CÁC HỌ VI MẠCH LOGIC CƠ BẢN 11 Hình (b) mô tả mối quan hệ giữa V out và V in của một cổng đảo Schmitt Trigger. Ký hiệu các cổng Schmitt Trigger. j. Yêu cầu về nguồn k. Tính đa dạng, khả năng tích hợp, giá thành, chế tạo, dễ phối hợp với vi mạch công nghệ khác. III. CÁC HỌ CỔNG LOGIC 1. HỌ DDL (DIODE DIODE LOGIC) Là họ cổng logic do các diode bán dẫn tạo thành. CÁC HỌ VI MẠCH LOGIC CƠ BẢN 12 (a) Sơ đồ cổng AND (b) Sơ đồ cổng OR Nguyên lý hoạt động của cổng rất đơn giản. Đối với trường hợp (a) chỉ duy nhất một tổ hợp biến vào A = B = H (logic 1) làm cả hai diode D1, D2 đều bị khóa và đầu ra Y lấy mức H, nghĩa là mạch thể hiện một cổng AND. Ngược lại, đối với hình (b), chỉ duy nhất tổ hợp A = B = L mới không tạo được dòng qua các diode và sụt áp trên R1 = 0. Tương ứng, đầu ra lấy mức L. Trường hợp này mạch thể hiện một cổng OR. CÁC HỌ VI MẠCH LOGIC CƠ BẢN 13 Ưu điểm của họ DDL: - Mạch điện đơn giản, dễ tạo ra các cổng AND, OR nhiều lối vào. Ưu điểm này cho phép xâu dựng các ma trận Diode với nhiều ứng dụng khác nhau. - Tần số công tác có thể đạt cao bằng cách chọn các diode chuyển mạch nhanh. - Công suất tiêu thụ nhỏ. Nhược điểm - Độ phòng vệ nhiễu thấp ( VRL lớn ) - Hệ số ghép tải nhỏ. Để cải thiện độ phòng vệ nhiễu ta có thể ghép nối tiếp ở mạch ra một diode. Tuy nhiên, khi đó VRH cũng bị sụt đi 0,6V. 2. HỌ DTL (DIODE-TRANSISTOR LOGIC) Bao gồm diode ở ngõ vào và transistor ở ngõ ra Ví dụ, cổng NAND DTL Ngõ ra Y kéo lên nguồn Vcc được gọi là ngõ ra kéo lên thụ động (Passive pull up) 3. HỌ TTL (TRANSISTOR-TRANSISTOR LOGIC) CÁC HỌ VI MẠCH LOGIC CƠ BẢN 14 Loại DTL sớm được thay thế bởi mạch TTL tức Transistor ở ngõ vào và Transistor ở ngõ ra. Ví dụ, cổng NAND TTL Lưu ý: khi các ngõ vào A,B để hở (thả nổi ngõ vào) thì không có dòng chảy ra ở A, B nên ngõ vào để hở giống như nối lên cao (logic 1) Đầu ra TTL hoạt độ__________ng như bộ thu nhận dòng ở trạng thái thấp (Q4) và cung cấp dòng ở trạng thái cao (Q3) CÁC HỌ VI MẠCH LOGIC CƠ BẢN 15 Ngõ ra Y kéo lên Transistor nên được gọi là ngõ ra kéo lên tích cực (Active pull up) hay còn gọi là ngõ ra cột chạm (Totel pole). Với Q3 sẽ không có dòng nào truyền qua Rc khi ngõ ra ở mức thấp nên sẽ giảm bớt dòng tiêu hao trong mạch. Trong khi kiểu kéo lên thụ động sẽ làm cho Q4 dẫn một dòng khá lớn khi ngõ ra ở mức thấp Ưu điểm thứ hai của cấu hình Totem pole là khi Y ở trạng thái cao, Q3 có trở kháng đầu ra thấp nên rất thuận tiện nếu tải có tính dung C Nhược điểm của cấu hình totem pole thể hiện trong giải đoạn chuyển tiếp từ thấp lên cao. Vì Q4 tắt chậm nên khi Q4 chưa tắt mà Q3 đã dẫn, thời gian này (vài ns) cả 2 transostor đều dẫn điện nên hút một dòng tương đối lớn. a. CÁC ĐẶC ĐIỂM CỦA HỌ TTL CHUẨN Các IC số họ TTL được sản xuất lần đầu tiên vào năm 1964 bởi hãng Texas Instrument Corporation của Mỹ, lấy số hiệu là 74XXXX & 54XXXX. Loạt IC TTL chuẩn đầu tiên gọi là seri 54/74. Sự khác biệt giữa 2 họ 74XXXX và 54 XXXX chỉ ở hai điểm: - 74: V CC =5 ± 0,5 V và khoảng nhiệt độ hoạt động từ 0 o C đến 70 o C - 54: V CC =5 ± 0,25 V và khoảng nhiệt độ hoạt động từ -55 o C đến 125 o C Các tính chất khác hoàn toàn giống nhau nếu chúng có cùng số. Trước số 74 thường có thêm ký hiệu để chỉ hãng sản xuất. Thí dụ SN của hãng Texas, DM của National Semiconductor, S của Signetics Ngoài ra trong quá trình phát triển, các thông số kỹ thuật (nhất là tích số công suất vận tốc) luôn được cải tiến và ta có các loạt khác nhau: 74 chuẩn, 74L (Low power), 74 H (High speed), 74S (Schottky), 74LS (Low power Schottky), CÁC HỌ VI MẠCH LOGIC CƠ BẢN 16 74AS (Advance Schottky), 74ALS (Advance Low power Schottky), 74F (Fast, Fair Child). Ví dụ, cổng NOR sẽ có các mã số khác nhau DM7402, SN7402… Khoảng nhiệt độ và điện thế nguồn Seri 74 vận hành trong khoảng điện thế 4.75 đến 5.25 và nhiệt độ 0OC đến 70OC Seri 54 chấp nhận điện thế nguồn trong khoảng 4.5 đến 5.5 và nhiệt độ - 55O đến 125OC Mức điện thế của seri 74 Tối đa Chuẩn Tối thiểu VOL 0.2 0.4 VOH 2.4 3.4 VIL 0.8 VIH 2.0 Công suất tiêu hao bình quân một cổng khoảng 10mW Thời gian trễ tiêu biểu tpLH=11ns và tpHL=7ns, trung bình 9ns Đầu ra TTL chuẩn có thể kích thích 10 đầu vào TTL chuẩn b. HỌ TTL CẢI TIẾN 74 74S 74LS 74AS 74ALS 74F CÁC HỌ VI MẠCH LOGIC CƠ BẢN 17 Định mức hiệu suất Trễ do truyền (ns) 9 3 9.5 1.7 4 3 Công suất (Mw) 10 20 2 8 1.2 6 Chỉ số giá trị (pJ) 90 60 19 13.6 4.8 18 Hệ số tải 10 20 20 40 20 33 Các thông số điện thế VOH (min) 2.4 2.7 2.7 2.5 2.5 2.5 VOL(min) 0.4 0.5 0.5 0.5 0.4 0.5 VIH(min) 2.0 2.0 2.0 2.0 2.0 2.0 VIL(min) 0.8 0.8 0.8 0.8 0.8 0.8 Các định mức dòng ngõ ra IOH (mA) -0.4 -1 -0.4 -2 -0.4 -1 IOL (mA) 16 20 8 20 8 20 Các định mức dòng ngõ vào IIH (μA ) 40 50 20 20 20 20 CÁC HỌ VI MẠCH LOGIC CƠ BẢN 18 IIL (mA) -1.6 -2 -0.4 -0.5 -0.1 -0.6 - Loạt 74S: Các transistor trong mạch được mắc thêm một Diod Schottky giữa hai cực CB với mục đích giảm thời gian chuyển trạng thái của transistor do đó làm giảm thời trễ truyền. - Loạt 74AS và 74ALS là cải tiến của 74S để làm giảm hơn nữa giá trị tích số Công suất - Vận tốc. - Loạt 74F: Dùng kỹ thuật đặc biệt làm giảm diện dung ký sinh do đó cải thiện thời trễ truyền của cổng. Ví dụ, Xác định giới hạn nhiễu DC cho một IC 74LS so sánh với IC 74 Ví dụ, Một đầu ra 74ALS kích thích 3 đầu vào 74S và một đầu vào 74 được không c. TTL VỚI NGÕ RA CỰC THU HỞ (OPEN COLLECTOR OUTPUT) Sơ đồ điển hình của NAND cực thu hở CÁC HỌ VI MẠCH LOGIC CƠ BẢN 19 Lưu ý: Mạch có cực thu để hở có thể được sử dụng như mạch Logic thông thường bằng cách mắc thêm R thích hợp với tình trạng của tải. d. HỌ TTL BA TRẠNG THÁI (TRISTATE) Ngoài 2 trạng thái cơ bản 1 và 0, các mạch logic còn có thêm trạng thái tổng trở cao Hi-Z Ví dụ xét cổng NOT 3 trạng thái sau 4. HỌ RTL (RESISTOR-TRANSISTOR LOGIC) Bao gồm các điện trở và transistor, đây là họ logic được tích hợp sớm nhất. Ví dụ, một cổng NOR RTL CÁC HỌ VI MẠCH LOGIC CƠ BẢN 20 Các mạch RTL có đặc tính chung là cần dòng IB cho các BJT nên còn được gọi là mạch thu dòng (current sinking), vì vậy khi kết nối với các mạch khác cần phải lưu ý để thỏa mãn điều kiện này, nếu không mạch sẽ không làm việc. Lề nhiễu ở trạng thái 0 là 0.5-0.2=0.3V Lề nhiễu ở trạng thái 1 phụ thuộc vào tải 5. MẠCH LOGIC MOS Gồm các IC số dùng công nghệ chế tạo của transistor MOSFET loại tăng, kênh N và kênh P . Với transistor kênh N ta có NMOS, transistor kênh P ta có PMOS và nếu dùng cả hai loại transistor kênh P & N ta có CMOS. Tính năng kỹ thuật của loại NMOS và PMOS có thể nói là giống nhau, trừ nguồn cấp điện có chiều ngược với nhau do đó ta chỉ xét loại NMOS và CMOS. Các transistor MOS dùng trong IC số cũng chỉ hoạt động ở một trong 2 trạng thái: dẫn hoặc ngưng. CÁC HỌ VI MẠCH LOGIC CƠ BẢN 21 - Khi dẫn, tùy theo nồng độ pha của chất bán dẫn mà transistor có nội trở rất nhỏ (từ vài chục Ω đến hàng trăm KΩ) tương đương với một khóa đóng. - Khi ngưng, transistor có nội trở rất lớn (hàng 10 10 Ω), tương đương với một khóa hở. Chuyển mạch MOSFET cơ bản Mạch số dùng MOSFET được phân thành 3 nhóm: P-MOS, N-MOS và CMOS Đặc điểm của logic MOS - So với họ lưỡng cực thì N-MOS và P-MOS có tốc độ hoạt động chậm hơn, tiêu hao năng lượng ít hơn, giới hạn nhiễu hẹp hơn, khoảng điện thế nguồn nuôi lớn hơn, hệ số tải lớn hơn và đòi hỏi ít chỗ trên chip hơn - Mức logic dành cho mạch MOS là V(0) ≈ 0V  V(1) ≈ VDD Đặc tính của họ MOS Một số tính chất chung của các cổng logic họ MOS (NMOS, PMOS và CMOS) có thể kể ra như sau: - Nguồn cấp điện : V DD từ 3V đến 15V - Mức logic: V OL (max) = 0V V OH (min) = V DD V IL (max) = 30% V DD V IH (min) = 70%V DD - Lề nhiễu : V NH = 30%V DD V NL = 30%V DD - Với nguồn 5V, lề nhiễu khỏang 1,5V, rất lớn so với họ TTL. - Thời trễ truyền tương đối lớn, khỏang vài chục ns, do điện dung ký sinh ở ngã vào và tổng trở ra của transistor khá lớn. CÁC HỌ VI MẠCH LOGIC CƠ BẢN 22 - Công suất tiêu tán tương đối nhỏ, hàng nW, do dòng qua transistor MOS rất nhỏ. - Số Fan Out: 50 UL Do tổng trở vào của transistor MOS rất lớn nên dòng tải cho các cổng họ MOS rất nhỏ, do đó số Fan Out của họ MOS rất lớn, tuy nhiên khi mắc nhiều tầng tải vào một tầng thúc thì điện dung ký sinh tăng lên (gồm nhiều tụ mắc song song) ảnh hưởng đến thời gian giao hoán của mạch nên khi dùng ở tần số cao người ta giới hạn số Fan Out là 50, nghĩa là một cổng MOS có thể cấp dòng cho 50 cổng tải cùng loạt. - Như đã nói ở trên, CMOS có cải thiện thời trễ truyền so với loại NMOS và PMOS, tuy nhiên mật độ tích hợp của CMOS thì nhỏ hơn hai loại này. Dù sao so với họ TTL thì mật độ tích hợp của họ MOS nói chung lớn hơn rất nhiều, do đó họ MOS rất thích hợp để chế tạo dưới dạng LSI và VLSI. a. HỌ CMOS Cổng cơ bản CMOS Họ CMOS sử dụng hai loại transistor kênh N và P với mục đích cải thiện tích số công suất vận tốc, mặc dù khả năng tích hợp thấp hơn loại N và P. (H 3.30a), (H 3.30b) và (H 3.30c) là các cổng NOT, NAND và NOR họ CMOS. CÁC HỌ VI MẠCH LOGIC CƠ BẢN 23 Bảng dưới cho thấy quan hệ điện thế của các ngã vào , ra cổng NOT V in T 1 T 2 V out V DD (logic1) R OFF =10 10 Ω RON = 1KΩ 0V (logic 0) 0V (logic0) RON = 1KΩ ROFF =10 10 Ω VDD (logic 1) Ngoài ra vận hành của cổng NAND và NOR được giải thích như sau:  Cổng NAND: - Khi 2 ngã vào nối lên mức cao, T 1 và T 2 ngưng, T 3 và T 4 dẫn, ngã ra xuống thấp. - Khi có 1 ngã vào nối xuống mức thấp, một trong 2 transistor T 3 hoặc T 4 ngưng, một trong 2 transistor T 1 hoặc T 2 dẫn, ngã ra lên cao. Đó chính là kết quả của cổng NAND 2 ngã vào. CÁC HỌ VI MẠCH LOGIC CƠ BẢN 24  Cổng NOR: - Khi 2 ngã vào nối xuống mức thấp, T 1 và T 2 dẫn, T 3 và T 4 ngưng, ngã ra lên cao. - Khi có 1 ngã vào nối lên mức cao, một trong 2 transistor T 3 hoặc T 4 dẫn, một trong 2 transistor T 1 hoặc T 2 ngưng, ngã ra xuống thấp. Đó chính là kết quả của cổng NOR 2 ngã vào. Các cổng CMOS khác Người ta cũng sản xuất các cổng CMOS với cực Drain để hở và ngã ra 3 trạng thái để sử dụng trong các trường hợp đặc biệt như họ TTL. CÁC HỌ VI MẠCH LOGIC CƠ BẢN 25 Hình (a) là một cổng NOT có cực D để hở, khi sử dụng phải có điện trở kéo lên Hình (b) là một cổng NOT có ngã ra 3 trạng thái: - Khi ngã vào Enable =1, T 1 và T 4 dẫn, mạch hoạt động như là cổng đảo, - Khi ngã vào Enable =0, T 1 và T 4 đều ngưng đưa mạch vào trạng thái Z cao. Ngoài ra lợi dụng tính chất của transistor MOS có nội trở rất nhỏ khi dẫn, người ta cũng chế tạo các mạch có khả năng truyền tín hiệu theo 2 chiều, gọi là khóa 2 chiều. (H 3.32) là một khóa 2 chiều với A là ngã vào điều khiển. Khi A = 0 khóa hở, khi A = 1, khóa đóng cho tín hiệu truyền qua theo 2 chiều. CÁC HỌ VI MẠCH LOGIC CƠ BẢN 26 Vận hành: T 3 và T 4 vai trò là một cổng đảo - Khi A = 0, cực G của T 2 ở mức thấp nên T 2 (kênh N) ngưng, cực G của T 1 (kênh P) ở mức cao nên T 1 ngưng, mạch tương đương với khóa hở. - Khi A =1, cực G của T 2 ở mức cao nên T 2 dẫn,